Curso Hardware Configuration and Definition for z/OS

  • Mainframe | Cobol

Curso Hardware Configuration and Definition for z/OS

32h
Visão Geral

 Você entenderá a função Hardware Configuration Definition (HCD) para z/OS e planejará e iniciará a reconfiguração dinâmica do ambiente de hardware zSeries.

Objetivo

Após concluir o Curso Hardware Configuration and Definition for z/OS, você será capaz de:

  • Descrever a nova tecnologia de processador zSeries
  • Codifique novos processadores zSeries (z9 a z196)
  • Codificar canais FICON e CTCs FICON
  • Code Coupling Facilities (CF) e links CF
  • Diretores FICON em cascata de código
  • Crie um arquivo de trabalho IODF no processador az do zero
  • Use a ferramenta de mapeamento CHPID para criar um IODF de trabalho validado
  • Use o IODF de trabalho e crie um IODF de produção
  • Execute mudanças de E/S dinâmica em um sistema z/OS real
  • Construir um membro LOADxx parmlib para carregamento inicial do programa (IPL)
  • Visualize a configuração graficamente
  • Crie relatórios de configuração apropriados
Publico Alvo
  • Este curso é para profissionais responsáveis ​​por manter a configuração de E/S contida nos arquivos de dados de entrada/saída (IODFs) e conjuntos de dados de configuração de entrada/saída (IOCDs) em sua instalação do z/OS.
Pre-Requisitos
  • Conhecimento básico de z/OS e configuração de E/S
Informações Gerais

Carga Horária: 32h

  • Se noturno este curso é ministrado de Segunda-feira à sexta-feira, das 19h às 23h
  • Se aos sábados este curso é ministrado das 9h às 18h
  • Se in-company por favor fazer contato para mais detalhes.

Formato de entrega: 

  • 100% on-line ao vivo, via Microsoft Teams na presença de um instrutor/consultor ativo no mercado.
  • Nota: não é curso gravado. 

Lab:

  • Laboratório + Exercícios práticos
Materiais
Português | Inglês
Conteúdo Programatico
  1. HCD introduction
  2. IOCP and MVSCP macro review
  3. HCD dialog
  4. LPAR and logical control unit concepts
  5. OSAs, OSA/ICC and HiperSockets
  6. Review of zSeries hardware
  7. zSeries I/O architecture: Logical channel subsystems
  8. Advanced DASD concepts: EAV/PAV and multiple subchannel sets
  9. FICON, FICON CTCs, and FICON directors
  10. HCD implementation and migration
  11. IPL and LOADxx member
  12. Dynamic I/O reconfiguration
  13. z196 HCD and using CMT
  14. FICON CTCs for sysplex
  15. HCD and Parallel Sysplex
TENHO INTERESSE

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